Western Digital оголошує про плани власного процесора RISC-V
RISC-V не була великою темою для нас на wfoojjaec, але архітектура набору команд із повністю відкритим вихідним кодом (ISA) в останні роки посилювала імпульс у галузі, оскільки більше компаній підписали контракт на будівництво RISC V -сумісні процесори. Хоча це не перша ISA із відкритим кодом, RISC-V призначена для використання на більш широкому діапазоні пристроїв, ніж деякі попередні роботи в цьому просторі. Зараз Western Digital оголосила, що має намір створити власний процесор RISC-V, що може стати головним проривним моментом для ISA в цілому.
RISC-V розробляється протягом багатьох років і має на меті бути практичним ISA для розвитку центрального процесора, а не строго навчальним завданням. Вступ Вікіпедії на ISA досить добре, якщо ви шукаєте огляд. За даними Western Digital, він інвестує в свій новий процесор, SweRV, як частину своєї мети постачати мільярд RISC-V ядер у свої різні запаси зберігання протягом року. WD побудує ядро SweRV - відкриту стандартну ініціативу для когерентної пам'яті в кеш-пам'яті по мережі (OmniXtend) та симулятора набору інструкцій з відкритим кодом RISC-V. Перші два проекти покликані покращити власні зусилля Western Digital на ринку зберігання, а третій - користі для спільноти RISC-V (загалом, крім самої WD).
"Оскільки великі дані та швидкі дані продовжують розповсюджуватись, цілі технології мають важливе значення для розблокування справжнього значення даних у сьогоднішніх широкомасштабних додатках, орієнтованих на дані", - заявив Western Digital CTO Мартін Фінк у своєму виступі. У окремому випуску прес-релізу в кінці листопада WD окреслив деякі його думки. Компанія стверджує, що ери "Великих Даних" і великі обсяги обробки даних менш піддаються застосуванню архітектури загального призначення для підвищення ефективності обчислень, ніж колись. Західний цифр вважає, що цей єдиний підхід до обробки є менш сумісним із вимогами сучасної епохи, ніж те, що іноді називають "архітектури, специфічні для конкретних областей".
RISC-V - західний цифровий спосіб шукати переваги продуктивності за допомогою архітектури центрального процесора, який можна налаштувати відповідно до власних потреб, а не намагатися вписатися в центральний процесор загального призначення. Звичайно, така обробка, про яку ми маємо на увазі, є досить низький рівень - ядро SweRV, як очікується, буде розгорнуто у SSD та флеш-контролерах, а не на традиційному сокеті ЦП. Цей новий процесорний ядро - це 32-розрядна конструкція в порядку, з двосторонньою суперскалярною архітектурою та дев'ятиступінчастим трубопроводом. Очікується, що годинник буде до 1,8 ГГц, побудований на 28-нм процесовому вузлі.
Читати далі
Micron оголошує про 176-шаровий NAND, обсяги поставок в даний час
Micron оголосив сьогодні про 176-шаровий NAND, що є вражаючим кроком вперед для галузі.
У рамках Massive Shift Apple оголошує про нові Mac з чіпом M1 на базі ARM
Компанія Apple бачила величезний успіх, коли востаннє перемикала архітектури на Intel, але цього разу? Журі все ще немає, але одне можна сказати точно: Apple збирається заробити набагато більше грошей.
Intel оголошує про закінчення життя своїх чіпсетів серії 300
Intel звільняє свої чіпсети серії 300, щоб звільнити місце для майбутнього Rocket Lake. 300-й серії процесорів 8-го та 9-го покоління живили до Core i9-9900K.
Як зупинити LG від набивання оголошень у ваш новий OLED-телевізор
LG вважає, що вам потрібно переглядати рекламу, щоб користуватися телевізорами. Ми не згодні.